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16 G 多协议 SerDes PHY 旨在在大数据和云应用的困难系统环境中最大限度地提高接口速度。这是一个完整的解决方案,采用面向系统的方法设计,为我们的客户提供最大的灵活性和轻松的集成。
Rambus 16G 多协议 SerDes (MPS) PHY 是一款高性能串行链路子系统。我们的 16G MPS PHY 针对铜背板和长距离电缆典型的挑战性高损耗信道的功耗和面积进行了优化,是网络、电信和数据中心系统的理想选择。
PHY 配有支持各种协议的 PMA 硬核和符合 PIPE4.2 标准的 PCIe 专用 PCS 软核。它们仅需最低程度的宽边控制,适用于 x2、x4 和 x8 通道配置。这提高了 PHY 的灵活性,可以支持各种应用。
MPSL 子系统示例
为了提升系统裕度和性能,我们的解决方案具有发送和接收均衡、数据速率协商和均衡自适应功能。这可以确保即使存在信道和系统干扰也能恢复数据。
可用于 TSMC、Global Foundry 和 Samsung 工艺节点。
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全面的芯片和系统设计审查
工程设计服务:
随着数据速率超过 28Gbps 达到 56Gbps 甚至更高,越来越难以保持信号完整性。在高达 28Gbps 的速率下,由 1 和 0 组成的 NRZ 是首选的标准化编码方案。NRZ 有两个幅度电平,其中在每个符号中包含 1 比特信息,因此也被称为 PAM2(2 电平脉冲幅度调制)。随着串行数据速率达到每个信道 56 Gb/s,带宽增加所导致的信号损伤促使高速串行数据行业采用 PAM4,即 4 电平脉冲幅度调制。对于 PAM4 信号,波特率等于比特率的一半,奈奎斯特频率等于比特率的四分之一。与 PAM2/NRZ 相比,PAM4 通过在每个符号中传输两比特,将给定数据速率的带宽减半。工程师因此可以将信道中的比特率翻倍,而无需将所需带宽增加一倍。
与基于 PLL 的 CDR 相比,降低了时钟和数据恢复 (CDR) 电路的成本、功耗和面积,提升了高速并行和串行链路的抖动性能。
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