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Rambus Ask the Experts: Exploring AI 2.0
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「専門家に聞く」Steven Woo: メモリランドスケープにおけるAI 2.0について  

「専門家に聞く」シリーズ、今回のエピソードでは、Rambus LabsのSteven Woo博士が、AI 1.0からAI 2.0へのAIの進化について解説します。Woo博士によると、AI 2.0は、複雑なリクエストを解釈し、テキスト、音声、コード、画像、音楽、動画、3Dモデルなど、幅広い出力を生成できる生成AIです。 AI 2.0は、大規模言語モデル(LLM)とAI技術を用いた新しいコンテンツ生成能力によって実現されました。Woo博士はまた、LLMの学習プロセス(学習セットの準備、モデルアーキテクチャの決定、反復学習、そして微調整)の4段階について詳しく説明しました。 議論はAIの普及にも触れ、Woo博士は半導体業界の進歩により、よりローカルな推論と学習が可能になると予測しました。最後に、Woo博士はAIの未来におけるチップ技術の重要性を強調し、より高速で効率的なプロセッサと、データの移動とセキュリティを確保するための技術の必要性を強調しました。  エキスパート Dr. Steven Woo, Fellow and Distinguished Inventor, Rambus Labs 重要なポイント AI 2.0の進歩:AI 2.0は次世代AI、つまり生成AIです。複雑なリクエストを解釈し、テキスト、音声、コード、画像、動画、さらには3Dモデルなど、幅広いマルチモーダル出力を生成することができます。この進歩は、LLMの急速な規模拡大とそれに伴う機能拡張によって実現されています。 大規模言語モデルのトレーニング: 大規模言語モデルのトレーニングには、適切なトレーニング セットの準備、モデルのアーキテクチャの決定、精度を向上させるための反復トレーニング、精度と有効性を維持するためのモデルの微調整という 4 つのステップが含まれます。 AIの普及:AIの普及は現在、推論分野で進んでおり、LLMはオープンソース化され、数百万人の人々が利用できるようになっています。今後、半導体がより高度化し、価格が手頃になるにつれて、ローカルトレーニングも普及され、携帯電話やノートパソコンなどのデバイスが個々のユーザーのニーズに合わせて自動調整できるようになるでしょう。 AIチップ技術:AI 2.0の主要チップ技術は、より高い電力効率でより高いパフォーマンスを提供する必要があります。これには、より高速で高性能なプロセッシングコア、膨大な量のデータを移動・保護するための技術、そしてより高いデータレートで信頼性の高いデータ伝送を実現する技術が含まれます。

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Rambus 高性能データセンターおよびAI SoC向けPCIe 7.0 IPポートフォリオを発表

AI(人工知能)とHPC(ハイパフォーマンスコンピューティング)における絶え間ないイノベーションは、かつてないほど膨大なデータの負荷に対応できる最先端のハードウェアインフラストラクチャを必要としています。こうした課題を克服し、パフォーマンスの新たな時代を切り開くため、RambusはPCI Express®(PCIe®)7.0 IPポートフォリオ(PCI Express® (PCIe®) 7.0 IP portfolio)の発表をします。このポートフォリオには、以下を含む包括的なIPソリューションスイートが含まれています: 次世代のAI および HPC アプリケーションに必要な高帯域幅、低レイテンシ、堅牢なパフォーマンスを実現するように設計された PCIe 7.0 コントローラ 信号再生(Signal regeneration)のための高度に最適化された低レイテンシのデータパスを実現するPCIe 7.0 リタイマー(Ritimer) 多数のアーキテクチャをサポートするために物理的に認識するPCIe 7.0 マルチポートスイッチ(Multi-port Switch) XpressAGENTTM により、ユーザーは最初のシリコンを迅速に立ち上げることができる 「新しいデータセンターアーキテクチャの出現に伴い、データセンターチップメーカーの市場が急成長を遂げています。堅牢で活気のあるエコシステムを構築するために、高性能インターフェースIPソリューションの提供が不可欠です」、「ラムバスのPCIe 7.0 IPポートフォリオは、比類のない帯域幅、低レイテンシ、そしてセキュリティ機能を提供することで、この課題に対処します。これらのコンポーネントは連携して動作し、AIおよびHPCアプリケーションの厳しい要求を満たす、シームレスで高性能なソリューションを提供します。」 Rambus PCIe 7.0 コントローラ IP の主な機能: 128 GT/sのデータレートを含むPCIe 7.0仕様をサポート リンクの堅牢性を高める低遅延前方誤り訂正(FEC, Forward Error Correction)の実装 高帯域幅効率を可能にするfixed-sized FLITs をサポート

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